SynaptiCAD Product Suite是一款用以电子器件互动交流设计方案的专用工具，这一互动交流定义围绕于全部的插口，包含HDL键入、模拟仿真、测试、波型剖析、引脚映射专用工具这些，是一个很详细的EDA计划方案，您能够刚开始剖析和模拟设计构思，无需经进行全部电源电路模型或平面图。
SynaptiCAD 出品的 EDA（电子设计自动化技术）专用工具结合，用以电子器件互动交流设计工具，这一互动交流定义围绕于全部的插口。包含HDL键入、模拟仿真、测试、波型剖析、引脚映射专用工具这些,是一个很详细的EDA计划方案。SynaptiCAD Product Suite 由电动机技术工程师造就设计方案的一款电子器件互动交流设计工具，这一互动交流定义围绕于全部的插口。您能够刚开始剖析和模拟设计构思，无需经进行全部电源电路模型或平面图，协助技术工程师她们的设计方案开展批判性思考的思考。
- 新项目级作用
1.Project Window中的New Port Mappings和Parm Mappings文件夹名称显示信息了测试模型如何连接到测试服务平台。除此之外，让客户变更映射。
2.Port Mappings图标色调标示映射是默认设置映射（翠绿色）還是自定映射（橘色）。在默认设置映射中，在测试服务平台中建立的数据信号与被测模型中端口号的准确名字相符合。当您要想测试例如2个联级并行加法器电源电路这类的设计方案而不最先建立包裝2个加法器的控制模块时，自定映射会很有效。
- BuHunter作用
1.tep Over和Step Into按键将起动模拟器（假如并未起动）。
2.GUI容许您在模拟进行后查看模拟情况，直至您按住鲜红色“完毕模拟”按键。务必先按“完毕模拟”按键，随后才可以刚开始新的模拟。
3.为GUI加上了模拟启用局部变量显示信息。这针对调节每日任务和函数的启用很有效。
- 时序图等级作用
1.在新项目对话框中显示信息包自变量便于于调节。
2.在“新项目”莱单中加上了“导出来时序图”，以将新项目中列举的全部时序图导出来为特殊文件格式。 此作用适用WaveFormer Pro和DataSheet Pro。 请参照第11.3节“导出来一般表明”。
3.新的cmd选择项-M将第二个时序图合拼到正在加载的时序图（之前此作用只有从GUI浏览，现在可以做为批处理命令实际操作实行）。
4.拓展vcd文档导进兼容模式。
BugHunter Pro：
一款用以 Verilog， VHDL 和 C 模拟器的图型调节系统软件。BugHunter 适用全部关键的 HDL 模拟器，其关键作用包含：单一流程调节、波型数据信息推流、项目风险管理这些。能够探测程序流程与协助系统软件的互动全过程进而发觉存在的问题。
VeriLogger Pro：
Verilog模拟器软件。出示一个综合性了传统式Verilog模拟器全部特点的模拟仿真自然环境，它具备强劲的图型测试矢量素材发生器。VeriLogger的迅速模型测试使客户能够对设计方案中的每一个模型开展“自底向上”的测试。
WaveFormer Pro：
由时序图解析器、模拟器和测试空间向量制作器组成。它为设计方案工作人员出示了一个集成化的自然环境，能够用于开发设计数据和模拟路线的时序图。WaveFormer Pro能够由Spice模拟器，Mathematica，或Matlab等专用工具键入模拟数据信息。还能够运用WaveFormer Pro 內部有着的波型涵数立即形成模拟数据信号；或是将从系统总线上获得的模拟信号转换成模拟数据信号。还能够将模拟数据信号波型逐段线形地转换成Spice模拟器的工作电压信号源。
TestBencher Pro：
用以从单独于語言的时钟频率逻辑性表形成互动式VHDL,Verilog, OpenVera,e, 和TestBuilder 测试标准及系统总线作用的模型。形成的测试标准能出示根据模拟仿真相对的不一样的激起空间向量，便于于测试标准作用做为一个被测试系统软件自然环境的姿势模型一切正常工作中。 TestBencher Pro是一个出色的测试规模性FPGA 和 ASIC设计方案的专用工具。
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